{"id":8753,"date":"2021-11-25T14:20:32","date_gmt":"2021-11-25T13:20:32","guid":{"rendered":"https:\/\/www.upm.es\/recursosidi\/offers-resources\/sin categor\u00eda\/un-metodo-y-un-dispositivo-de-procesamiento-en-paralelo-de-instrucciones-de-programa-e-instrucciones-de-traza\/"},"modified":"2022-08-10T02:20:14","modified_gmt":"2022-08-10T00:20:14","slug":"un-metodo-y-un-dispositivo-de-procesamiento-en-paralelo-de-instrucciones-de-programa-e-instrucciones-de-traza","status":"publish","type":"product","link":"https:\/\/www.upm.es\/recursosidi\/offers-resources\/patentes\/un-metodo-y-un-dispositivo-de-procesamiento-en-paralelo-de-instrucciones-de-programa-e-instrucciones-de-traza\/","title":{"rendered":"Un m\u00e9todo y un dispositivo de procesamiento en paralelo de instrucciones de programa e instrucciones de traza"},"content":{"rendered":"
Descripci\u00f3n de la patente <\/h5>\n

M\u00e9todo y dispositivo de sincronizaci\u00f3n y ejecuci\u00f3n paralela de instrucciones de traza sobre un procesador RISC segmentado. La invenci\u00f3n consiste en un dispositivo cuya estructura interna, basada en un procesador segmentado, permite eliminar la sobrecarga de tiempo de ejecuci\u00f3n que introduce la instrumentaci\u00f3n de c\u00f3digo empleada para medir el tiempo de ejecuci\u00f3n en el peor caso. Para ello el dispositivo utiliza un c\u00f3digo de instrucci\u00f3n espec\u00edfico para la instrumentaci\u00f3n, que es interpretado como la habilitaci\u00f3n de traza de la instrucci\u00f3n que le precede, y que permite identificar un\u00edvocamente el momento de ejecuci\u00f3n de dicha instrucci\u00f3n. El dispositivo propuesto ejecuta en paralelo, y de forma sincronizada, cada instrucci\u00f3n de traza con la instrucci\u00f3n a trazar que le precede, y condiciona dicha ejecuci\u00f3n a que se complete, sin que se vea afectada por burbujas, la ejecuci\u00f3n de la instrucci\u00f3n a trazar.<\/p>\n

Situaci\u00f3n <\/h5>\n

Concedida<\/p>\n

N\u00famero de solicitud<\/h5>\n

P201830266<\/p>\n

N\u00famero de publicaci\u00f3n<\/h5>\n

ES2697548<\/p>\n

Fecha de presentaci\u00f3n <\/h5>\n

20\/03\/2018<\/p>\n

Fecha de publicaci\u00f3n <\/h5>\n

24\/01\/2019<\/p>\n

Fecha de concesi\u00f3n <\/h5>\n

15\/07\/2020<\/p>\n

Extensiones Internacionales<\/strong><\/h4>\n
PCT<\/h5>\n

Referencia de la solicitud: <\/strong>PCT\/ES2019\/070176
T\u00edtulo: <\/strong>Un m\u00e9todo y un dispositivo de procesamiento en paralelo de instrucciones de programa e instrucciones de traza <\/p>\n

Descargar ficha<\/span><\/a><\/div>","protected":false},"excerpt":{"rendered":"

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