Observatorio de I+D+i UPM

Memorias de investigación
Ponencias en congresos:
Power Estimation of Dividers Implemented in FPGAs
Año:2011
Áreas de investigación
  • Microelectrónica
Datos
Descripción
We present a methodology for power estimation of nonfractional divider cores implemented in FPGAs. The methodolgy takes into account the divider structure and the signal statistics at the inputs: mean, variance, and autocorrelation. An analytical model is used for switching activity computation. The strong data dependency observed at the inputs of the divider basic elements is properly modelled in order to improve the model accuracy. The methodology is capable of obtaining fast and accurate estimates when compared to both, real on-board measurements and XPower. The mean relative error is less than 10%, with a maximum error of 22% when estimates are compared to on-board measurements and less than 11% when estimates are compared to low-level estimates provided by the commercial tool. divider are derived in order to enable signal propagation to the other components in the design.
Internacional
Si
Nombre congreso
ACM/SIGDA Great Lakes Symposium on VLSI, GLSVLSI'11
Tipo de participación
960
Lugar del congreso
Lausana (Suiza)
Revisores
Si
ISBN o ISSN
978-1-4503-0667-6
DOI
Fecha inicio congreso
02/05/2011
Fecha fin congreso
04/05/2011
Desde la página
313
Hasta la página
318
Título de las actas
Proceedings of the ACM/SIGDA Great Lakes Symposium on VLSI
Esta actividad pertenece a memorias de investigación
Participantes
  • Autor: Ruzica Jevtic . (UPM)
  • Autor: Bojan Jovanovic (University of Nis)
  • Autor: Carlos Carreras Vaquer (UPM)
Grupos de investigación, Departamentos, Centros e Institutos de I+D+i relacionados
  • Creador: Grupo de Investigación: Laboratorio de Sistemas Integrados (LSI)
  • Departamento: Ingeniería Electrónica
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